半導体パッケージの異種デバイス集積化プロセスの基礎と最新技術動向

セミナー趣旨

　AIの進展と5G通信の本格普及に向けて、データを生成元の近くでリアルタイム処理するエッジコンピューティングの高性能化、多機能化に自在に応えるためには、電子部品を含む異種デバイス集積化によりモジュール機能を創出するプラットフォームの役割を半導体パッケージが担うことが期待されています。機能別に小チップに分割した複数の異種チップとメモリをSiインタポーザやSiPに集積する”Chiplet”構造を採用した最新のプロセッサ製品は、ム－ア則を補完するデバイス性能向上とチップサイズ縮小による経済性の両立へ拡張する半導体パッケージ開発の恩恵を享受しており、また、既存のパッケージ基板、PCB、LCDの業態階層を崩すパネルレベルパッケージプロセスの開発は、新たなエコシステムを構築しつつあります。
　本セミナーでは、半導体デバイス集積化の基幹技術であるマイクロバンプ、再配線、TSV、FOWLP、三次元デバイス積層のプロセスの基礎をおさらいし、再配線の微細化、FOWLP/PLPの三次元化の課題を整理し、異種デバイスの三次元集積化を見据えた今後の市場動向と技術動向を展望します。

受講対象・レベル

【受講者レベル】
半導体プロセス、パッケージの初歩的な知識をお持ちであれば、内容の一層の理解の助けになりますが、専門的知識は不要です。

【受講対象者】
・Bump、再配線、WLP､ TSV等の中間領域技術に関心のある装置メーカー、材料メーカーの方
・FOWLP、FOPLPの商流、市場動向、開発動向に関心のある方
・LCDパネルプロセス技術者の方

習得できる知識

・チップレットSiPの基礎になるBump、再配線、TSV、Fan-Outパッケージのプロセスの基礎知識
・異種デバイスの三次元集積化プロセスの基礎
・FOPLPの課題整理
・最近の半導体パッケージの役割の変化を理解するために既存の配線技術階層を横断する視点

セミナープログラム

１．半導体パッケージの役割の変化
　1.1 中間領域プロセスの位置付け
　1.2 後工程の前工程化
　1.3 中間領域プロセスによる製品の価値創出事例
　1.4 チップレットSiP

２．三次元集積化デバイス形成プロセス技術と最新動向
　2.1 広帯域メモリチップとロジックチップの積層化
　　a) Logic-on-DRAM SoCデバイス
　　b) InFO POP
　　c) 2.5Dインテグレーション
　2.2 再配線、マイクロバンプ、TSVの形成プロセスの基礎と留意点
　　a) 再配線形成プロセスの微細化
　　b) マイクロバンプ形成プロセスとバンプピッチ縮小化
　　c) TSV形成プロセス(via middle, back side via)選択
　2.3 三次元積層化プロセスの基礎とその留意点
　　a) 微少量半田接合部の熱的安定性
　　b) TSV積層プロセスの課題
　2.4 再配線の絶縁被覆樹脂膜材料と配線信頼性について
　　a) 配線信頼性の基礎
　　b) 再配線の絶縁樹脂膜界面におけるCu酸化
　　c) LSIダマシン配線と再配線の構造比較
 
３．Fan-Out Wafer Level Package（FOWLP） プロセス技術と最新動向
　3.1　FOWLPの市場浸透
　3.2　FOWLPプロセスの基礎と留意点
　　a) 再構成基板形成・支持基板剥離
　　b) 材料物性指標
　　c) プロセスインテグレーション
　　d) 不良事例・信頼性評価事例
　　e) Fan-Out WLPのコスト構造解析事例
　3.3　三次元FOWLPのThrough Mold Interconect(TMI)プロセス
　　a) Tall Cu pillar
　　b) Vertical wire bonding
　　c) Laser via drilling
　　d) Photosensitive thick dielectric polymer
 
４．Fan-Out Panel Level Package（FOPLP）の課題
　4.1 量産化へ向けて克服すべき課題
　4.3 装置開発事例
 
５．今後の半導体パッケージの市場動向・開発動向・課題
　5.1 最近の注目開発事例
　　a) Hybrid Panel FOによるメモリ多段積層
　　b) CoWによる異種デバイス集積化
　5.2 最近の市場概観とトピックス紹介
　5.3 今後の商流と事業主体の変化
 
６．まとめ
 
□ 質疑応答 □

セミナー講師

神奈川工科大学 工学部・電気電子情報工学科 非常勤講師　江澤 弘和 氏
(元 東芝メモリ（現 キオクシア）)

【略歴】
　1985年、(株)東芝入社。Siウエーハの高品位化業務を経て、LSIプロセス開発部門に転籍後30年以上に亘り、スパッタ、メタルCVD、めっきによる金属配線成膜及び微細孔埋め込みプロセスを中心に、先端デバイスの微細化開発に従事。並行して、非Pb半田Bump、Low-k CPI、Cu再配線、TSV、WLP等の中間領域プロセス開発を推進。2011年、同社メモリ事業部へ転籍後、TSV、再配線、WLPを用いたフラッシュメモリの高速化と低消費電力化の両立開発に従事。2017年、東芝メモリ（株）へ転出、2019年9月、同社を定年退職。現在に至る。

1985年、京大院・工・磁性物理学講座・修士課程修了
2015年、早大院・情報生産システム研究科・先進材料研究室・博士後期課程修了・博士（工学）取得
2018年４月より、神奈川工科大学・非常勤講師（電気電子材料担当）
日本金属学会、IEEEに所属

セミナー受講料

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